賽思時(shí)鐘緩沖器芯片
時(shí)鐘緩沖器芯片時(shí)鐘芯片是一種基于PLL的時(shí)鐘發(fā)生器,采用ADPLL(全數(shù)字鎖相環(huán))技術(shù),以實(shí)現(xiàn)的高頻低相噪性能,并具備低功耗和高PSNR能力,可實(shí)現(xiàn)小于0.3ps RMS的相位抖動(dòng)性能。
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更新日期
2024-10-10 - 02
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